AMD 新一代霄龙处理器‘威尼斯’进入量产采用台积电 2nm 工艺
AMD第六代霄龙处理器“威尼斯”已量产,采用台积电2纳米工艺,是业界首款该工艺高性能计算产品。下一代“维拉诺”将优化能效与性价比,支持LPDDR内存。双方合作还涉及先进封装技术,共同推动高集成度计算平台发展。
今天,AMD的一则消息在半导体圈内传开了:代号为“Venice”的第六代霄龙处理器,已经在台积电位于中国(T-W)地区的工厂进入了量产爬坡阶段。更值得关注的是,后续的量产计划还将推进至台积电的亚利桑那州晶圆厂。

根据官方发布的信息,“Venice”这款产品来头不小,它是业界首个采用台积电2纳米制程工艺的高性能计算(HPC)处理器。选择在这个时间点推进量产,并非偶然。眼下,AMD在服务器市场的份额正稳步提升,无论是云计算巨头、高性能计算中心,还是前沿的AI客户,选择霄龙处理器的名单正在变长。
当然,这只是一个开始。AMD的路线图显示,台积电的2纳米工艺将被系统地导入其整个数据中心CPU产品线。紧接“Venice”之后的,是同样隶属于第六代霄龙家族的“Verano”。这款产品的设计重点非常明确——优化“每美元性能”和“每瓦性能”。说白了,就是在有限的成本和功耗预算内,挤出更多的算力。为此,它将提供对LPDDR内存的支持,这对于那些对功耗极其敏感的云计算和AI应用场景来说,无疑是个好消息,意味着能在同样的电力下获得更高的性能和带宽。
除了先进的制程,AMD与台积电的合作深度还体现在封装技术上。SoIC-X和CoWoS-L这些前沿的3D封装与集成技术,都将被用于未来的平台。随着2纳米的“Venice”迈入量产阶段,一个信号已经非常清晰:AMD正在联手台积电,推动更高集成度、更大规模的计算平台从蓝图变为现实。这场围绕尖端工艺和先进封装的竞赛,已经进入了新的赛道。
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