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希奥端计算将基于赛昉Dubhe-100 CPU IP打造RISC-V服务器CPU
希奥端计算将基于赛昉Dubhe-100 CPU IP打造RISC-V服务器CPU

赛昉科技宣布希奥端计算将基于其Dubhe-100CPUIP,开发面向智能边缘的RISC-V服务器CPU。双方通过深度定制合作,针对高性能、高能效及安全需求进行联合优化打磨,为RISC-V在服务器领域开辟新路径,具有重要意义。

RISC-V、Multi-Die、低功耗(芯片设计资料)
RISC-V、Multi-Die、低功耗(芯片设计资料)

Arteris作为片上网络IP与SoC集成自动化领先提供商,围绕RISC-V、多裸片(Multi-Die)及低功耗三大方向,展示了关键芯片设计资料与技术信息,助力高效异构集成与能耗优化,推动先进芯片架构创新。

低功耗、RISC-V、Multi-Die(芯片设计资料)
低功耗、RISC-V、Multi-Die(芯片设计资料)

Arteris是全球领先的片上网络IP与SoC集成自动化软件提供商,在芯片互联领域处于顶尖地位,提供低功耗、RISC-V、Multi-Die相关设计资料,助力高效多芯片系统设计。

主播自制家用RISC-V GPU:环形布局、8192核心、2161W功耗
主播自制家用RISC-V GPU:环形布局、8192核心、2161W功耗

主播用8192颗QingKeCH570微控制器自制GPU,环形布局,每颗芯片焊RGBLED作像素。当前功耗2161瓦、电流655安,计划达320×200分辨率需64000颗芯片。

主播自制家用 RISC-V GPU:环形布局、8192 核心、2161W 功耗
主播自制家用 RISC-V GPU:环形布局、8192 核心、2161W 功耗

主播MatthiasBalwierz使用8192颗沁恒微电子QingKeCH570RISC-V微控制器自制GPU,采用环形布局,单芯片集成RGBLED,总功耗达2161瓦。当前为第一阶段样机,目标分辨率320×200需堆叠64000颗芯片,旨在验证RISC-V生态极度并行化构建显卡的可行性。

硬件玩家自制GPU 用6.4万颗 RISC-V芯片拼出一块显卡
硬件玩家自制GPU 用6.4万颗 RISC-V芯片拼出一块显卡

硬件极客用6.4万颗廉价RISC-V微控制器自制GPU,每颗芯片直接驱动一个RGBLED像素,构成自发光计算阵列。当前原型由8192颗芯片组成,功耗达2161瓦,采用分层管理和自制编程工具烧录,验证了海量低成本单元构建并行图形系统的可能性。

“一芯一像素”,用 6.4 万颗 0.13美元的RISC-V 自制一颗GPU
“一芯一像素”,用 6.4 万颗 0.13美元的RISC-V 自制一颗GPU

德国黑客Bitluni用6.4万颗单价0.13美元的RISC-V芯片CH570制成GPU,每芯片对应一像素,分辨率320×200,功耗约2161W,通过3D打印机自动烧录,验证了海量廉价弱单核强并行的另类图形处理架构。

联想问天全球首款RISC-V服务器亮相WAIC 2026
联想问天全球首款RISC-V服务器亮相WAIC 2026

2026年世界人工智能大会上,联想发布全球首款RISC-V服务器问天WR5219G5,搭载48核异构蓝芯LX500,支持PCIe5.0和DDR5,适用于AI推理、虚拟化、科学计算,深度适配本土算力生态。

联想问天全球首款 RISC-V 服务器亮相 WAIC 2026,搭载蓝芯 LX500 处理器
联想问天全球首款 RISC-V 服务器亮相 WAIC 2026,搭载蓝芯 LX500 处理器

联想问天WR5219G5服务器亮相WAIC2026,搭载48核异构蓝芯LX500RISC-V处理器,支持PCIe5.0和DDR5,覆盖AI推理、虚拟化、科学计算等负载,深度适配本土算力生态,兼容国际主流与国产芯片架构。

奕斯伟计算推出RISC-V AI NAS主控方案  助力极空间打造全球首款消费级RISC-V AI NAS新品
奕斯伟计算推出RISC-V AI NAS主控方案 助力极空间打造全球首款消费级RISC-V AI NAS新品

奕斯伟计算推出RISC-VAINAS主控方案,与极空间合作,将于2026年第四季度量产全球首款消费级RISC-VAINAS。该方案采用自研四核64位RISC-VCPU与高能效NPU,支持AI识别、本地部署大模型,数据全程本地处理,覆盖个人、家庭、办公等多元场景。

NextSilicon 规划 64、128 核心企业级 RISC-V 处理器,预计 2028 年初上市
NextSilicon 规划 64、128 核心企业级 RISC-V 处理器,预计 2028 年初上市

NextSilicon计划于2028年初推出基于自研Arbel架构的64核与128核企业级RISC-V处理器,目标频率3.4GHz。该处理器支持RVA-23配置文件、10宽发射、480条目ROB、16条标量指令并行及四个128位矢量单元,采用TAGE分支预测器。此前已在台积电5nm工艺完成2.5GHz测试芯片流片。

NextSilicon规划128核RISC-V处理器,预计2028年初上市
NextSilicon规划128核RISC-V处理器,预计2028年初上市

NextSilicon推出自研RISC-V架构Arbel的64/128核企业级处理器,目标3.4GHz,2028年初上市。5nm测试芯片已流片,实测2.5GHz,客户已验证并敲定量产技术要求,量产将采用更先进工艺。

进迭时空第三代 RISC-V 处理器核 X200 完成研发:香山昆明湖架构,性能翻倍
进迭时空第三代 RISC-V 处理器核 X200 完成研发:香山昆明湖架构,性能翻倍

进迭时空第三代RISC-V处理器核X200已完成研发,基于香山昆明湖架构,单核性能较上代提升超100%。该核芯针对AI、云计算及Agent等场景专项优化,支持RVA23.1标准与高阶向量计算,单簇可扩展至12核,并强化了多核互联与缓存系统。预计2027年实现量产,同时下一代X300研发已启动。

加速RISC-V芯片上车,东风、长城、广汽、一汽、比亚迪发起专委会
加速RISC-V芯片上车,东风、长城、广汽、一汽、比亚迪发起专委会

中国汽车芯片产业创新战略联盟RISC-V车规芯片专委会正式成立 就在上周,2026北京车展的中国芯展区迎来了一则重磅消息。4月26日,中国汽车芯片产业创新战略联盟RISC-V车规芯片专委会正式宣告成立。这可不是一个普通的行业会议,而是标志着中国智能汽车产业链在底层核心技术自主化道路上,又迈出了关键且

深度数智展示DC-ROMA RISC-V主板III,兼容Framework生态
深度数智展示DC-ROMA RISC-V主板III,兼容Framework生态

深度数智携进迭时空K3 SoC亮相,DC-ROMA RISC-V主板III即将发布 上周的Framework [Next Gen] Event 2026发布活动上,有款硬件吸引了开发者和极客们的目光——深度数智(DeepComputing)展出了搭载进迭时空(SpacemiT)K3 SoC的DC-R

Imagination 推出 RISC-V 处理器 APXM-6200:性能比 Cortex-A53 高 65%
Imagination 推出 RISC-V 处理器 APXM-6200:性能比 Cortex-A53 高 65%

本站4月9日消息,RISC-V领军企业ImaginationTechnologies去年11月裁员20%,并未停止前进的脚步,近日推出了APXM-6200CPU。本站附上宣传视频如下:APXM-6200CPU是一款64位应用处理器,具有11级双通道管线(11-stage,dual-issuepipeline),与市场上已有的同类CPU相比,APXM-6200的性能比ArmCortex-A53高65%,相比Coretx-A510高20%。在性能密度方面,APXM-6200更是达到了Cortex-A53的2.

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